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VHDL語(yǔ)言技術(shù)社區(qū)

技術(shù)資訊

VHDL語(yǔ)言

　　VHDL語(yǔ)言是由美國(guó)國(guó)防部在 20 世紀(jì) 80 年代初為實(shí)現(xiàn)其高速集成電路計(jì)劃 (very high speed integrated circuit——VHSIC)而提出的一種 HDL——VHDL(高速集成電路硬件描述語(yǔ)言)。目的是為了給數(shù)字電路的描述與模擬提供一個(gè)基本的標(biāo)準(zhǔn)。VHDL語(yǔ)言作為高級(jí)硬件行為描述型語(yǔ)言，如今已經(jīng)廣泛被應(yīng)用到FPGA/CPLD和ASIC中的設(shè)計(jì)?！　?yán)格地講，VHDL是一種用來描述數(shù)字邏輯系統(tǒng)的“編程語(yǔ)言”。查看更多>>

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VHDL語(yǔ)言資訊

一種基于CPLD的DMA控制器IP核設(shè)計(jì)

但是由于8013硬件結(jié)構(gòu)和指令系統(tǒng)的限制，當(dāng)需要高速率大批量數(shù)據(jù)傳送時(shí)，數(shù)據(jù)吞吐速率往往不能滿足設(shè)計(jì)要求。即使采用提升振蕩器頻率的辦法，結(jié)果仍不...

可編程邏輯器件 CPLD 2018-07-27

一種高效多串口單一中斷源的芯片設(shè)計(jì)

...

多串口單一中斷源 2010-07-28

基于CPLD的MIDI音樂播放器的設(shè)計(jì)

摘要：本音樂播放器依據(jù)MIDI音樂基本原理，結(jié)合EDA技術(shù)，采用ALTERA公司的可編程邏輯器件（CPLD）EPF10LC84-4作為控制核心而設(shè)計(jì)的。本文主要闡述了利用VHDL語(yǔ)言設(shè)計(jì)MIDI音樂發(fā)生器芯片，再配上必要...

EDA CPLD 2008-05-29

基于VHDL語(yǔ)言的IP核驗(yàn)證

引言在IC(integrated circuit．集成電路)發(fā)展到超大規(guī)模階段的今天，基于IP(Intellectual Property，知識(shí)產(chǎn)權(quán))核的IC設(shè)計(jì)及其再利用是保證SoC(s...

IP核 VHDL語(yǔ)言 2007-04-28

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