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標(biāo)簽

VHDL/VerilogHD技術(shù)社區(qū)

VHDL/VerilogHD

VHDL/VerilogHD技術(shù)社區(qū)為您提供最新的VHDL/VerilogHD相關(guān)技術(shù)資訊、VHDL/VerilogHD的技術(shù)資料、VHDL/VerilogHD的電路設(shè)計方案、VHDL/VerilogHD的視頻資料、VHDL/VerilogHD的相關(guān)元器件資料以及VHDL/VerilogHD的技術(shù)應(yīng)用。

全部資訊資料電路論壇

VHDL/VerilogHD資訊

高云半導(dǎo)體自主研發(fā)的邏輯綜合工具Gowin Synthesis支持VHDL硬件描述語言

全球增長最快的可編程邏輯公司-廣東高云半導(dǎo)體科技股份有限公司（以下簡稱“高云半導(dǎo)體”）近日宣布，高云半導(dǎo)體自主研發(fā)的邏輯綜合工具Gowin Synthesis支持VHDL（Very-High-Speed Integrat...

半導(dǎo)體 VHDL 2020-04-01

一文看懂VHDL和Verilog有何不同

　　當(dāng)前最流行的硬件設(shè)計語言有兩種，即 VHDL 與 Verilog HDL，兩者各有優(yōu)劣，也各有相當(dāng)多的擁護者。VHDL 語言由美國軍方所推出，最早通過國際電機工程師學(xué)會(IEEE)的標(biāo)準(zhǔn)，在北美及歐洲應(yīng)用非常普遍。而...

VHDL Verilog 2018-11-08

VHDL語言實現(xiàn)的幀同步算法

數(shù)字通信網(wǎng)中，幀同步是同步復(fù)接設(shè)備中最重要的部分，他包括幀同步碼的產(chǎn)生和幀同步碼的識別，其中接收端的幀同步識別電路的結(jié)構(gòu)對同步性能的影響是主...

VHDL 幀同步 2018-09-11

基于CPLD的測試系統(tǒng)接口設(shè)計

介紹了一種用CPLD(復(fù)雜可編程邏輯器件)作為核心控制電路的測試系統(tǒng)接口，通過時cPLD和竹L電路的比較及cPLD在系統(tǒng)中實現(xiàn)的強大功能，論述了CPLD在測試系...

EDA CPLD 2018-07-27

基于VHDL邏輯電路設(shè)計與應(yīng)用

隨著集成電路技術(shù)的高速發(fā)展，VHDL已成為設(shè)計數(shù)字硬件時常用的一種重要手段。介紹EDA技術(shù)及VHDL語言特點，以串行加法器為例，分析串行加法器的工作原理...

EDA VHDL 2018-07-27

基于FPGA的Petri網(wǎng)的硬件實現(xiàn)

Petri網(wǎng)是異步并發(fā)現(xiàn)象建模的重要工具，Petri網(wǎng)的硬件實現(xiàn)將為并行控制器的設(shè)計提供一種有效的途徑.本文在通用的EDA軟件Max+PlusII中，研究了基本Petr...

EDA技術(shù) FPGA 2018-07-27

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一種多功能電子密碼鎖的VHDL設(shè)計

FPGA實現(xiàn)的數(shù)字密碼鎖

基于FPGA的通用數(shù)控分頻器的設(shè)計與實現(xiàn)

基于VHDL的洗衣機控制器的設(shè)計

VHDL/VerilogHD資料

VHDL語言基礎(chǔ)的學(xué)習(xí)課件免費下載

VHDL 2024-07-29 立即下載

FPGA，Verilog，vhdl

FPGA Verilog 2022-02-21 立即下載

FPGA，Verilog，vhdl

FPGA Verilog 2021-02-25 立即下載

VHDL編程風(fēng)格.pdf

VHDL 編程 2021-01-28 立即下載

選擇VHDL還是Verilog.pdf

VHDL Verilog 2020-12-05 立即下載

FPGA，Verilog，vhdl

FPGA Verilog 2020-10-23 立即下載

FPGA，Verilog，vhdl

FPGA Verilog 2020-10-23 立即下載

FPGA，Verilog，vhdl

FPGA Verilog 2020-08-28 立即下載

FPGA/IC

FPGA Verilog 2020-08-11 立即下載

FPGA，Verilog，vhdl

FPGA Verilog 2020-08-07 立即下載

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VHDL/VerilogHD論壇

01-28 資料分享 | 講義《VHDL編程風(fēng)格與技巧》pdf下載

zxopenljx|瀏覽：2907|回復(fù)：6| zxopenljx 2021-02-26 16:37:05

12-05 選擇VHDL還是Verilog.pdf

zxopenljx|瀏覽：1514|回復(fù)：3| 同煮山川 2020-12-08 22:46:19

07-26 VHDL算術(shù)邏輯器件設(shè)計.pdf

zxopenljx|瀏覽：2346|回復(fù)：4| Dummer3 2020-10-26 21:53:19

06-30 基于VHDL的4PSK調(diào)制器設(shè)計與仿真.pdf

zxopenljx|瀏覽：2201|回復(fù)：3| 同煮山川 2020-10-24 23:18:50

01-08 5級M序列生成總有問題！求大神幫忙看下，到底是哪里不對？

正這個方|瀏覽：3913|回復(fù)：0| 正這個方 2016-01-08 14:58:54

11-20 CPLD VHDL 如何在一個時鐘周期的低電平期間產(chǎn)生多個脈沖？

bly5668|瀏覽：11988|回復(fù)：0| bly5668 2015-11-20 14:05:45

06-12 電子鐘VHDL設(shè)計

dolphin|瀏覽：4297|回復(fù)：1| ArielLin 2016-07-02 22:46:51

06-12 vhdl_vhdl是什么

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