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標簽 DPLL技術社區(qū)

DPLL

背景知識： 隨著數(shù)字電路技術的發(fā)展，數(shù)字鎖相環(huán)在調(diào)制解調(diào)、頻率合成、FM 立體聲解碼、彩色副載波同步、圖象處理等各個方面得到了廣泛的應用。數(shù)字鎖相環(huán)不僅吸收了數(shù)字電路可靠性高、體積小、價格低等優(yōu)點，還解決了模擬鎖相環(huán)的直流零點漂移、器件飽和及易受電源和環(huán)境溫度變化等缺點，此外還具有對離散樣值的實時處理能力，已成為鎖相技術發(fā)展的方向。鎖相環(huán)是一個相位反饋控制系統(tǒng)，在數(shù)字鎖相環(huán)中，由于誤差控制信號是離散的數(shù)字信號，而不是模擬電壓，因而受控的輸出電壓的改變是離散的而不是連續(xù)的;此外，環(huán)路組成部件也全用數(shù)字電路實現(xiàn)，故而這種鎖相環(huán)就稱之為全數(shù)字鎖相環(huán)(簡稱DPLL)。 基本原理： 傳統(tǒng)的數(shù)字鎖相環(huán)是利用輸人信號與其輸出信號之間的相位差別來跟蹤輸人信號，但由于鎖相環(huán)具有一定的捕捉時間，采用這種數(shù)字鎖相環(huán)不能準確提取輸人信號的每一周期的相位改變，不能用于數(shù)顯裝置的動態(tài)測量。查看更多>>

  • DPLL資訊

基于FPGA全新鎖相倍頻系統(tǒng)的設計

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ADI AD9554 2014-05-22

DSP平臺的數(shù)控逆變中頻電源的設計與實現(xiàn)

逆變電源 DSP 2013-09-23

GSM、WCDMA和LTE應用的高集成度SyncE器件

DPLL NCO 2012-04-23

基于FPGA的DDS+DPLL跳頻信號源設計

FPGA DPLL 2011-08-19

基于FPGA的提取位同步時鐘DPLL設計

FPGA DPLL 2009-12-28
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