并行技術(shù)社區(qū)

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并行資訊

基于大規(guī)模并行GPU光柵化器加速計算光刻技術(shù)

隨著半導(dǎo)體制造工藝不斷向更先進(jìn)的納米制程邁進(jìn)，計算光刻已從芯片設(shè)計的輔助環(huán)節(jié)，發(fā)展成為先進(jìn)芯片設(shè)計的核心支柱。如今，掩模合成、光刻仿真以及光學(xué)鄰近效應(yīng)校正（OPC）對計算精度和數(shù)據(jù)處理吞吐量提出了前所未有的要求。而這些工...

并行 GPU 2026-03-20

從并行到串行再返回：對SerDes的理解

串行化/去串行化電路，統(tǒng)稱為SerDes，為數(shù)字通信系統(tǒng)提供了重要的好處，尤其是當(dāng)需要高數(shù)據(jù)速率時。在我工程生涯的早期，我認(rèn)為并行通信通常比串行通信更可取。我很欣賞同時移動所有8個（或16個，或32個…）數(shù)據(jù)位的簡單性和...

202408 SerDes 2024-05-17

Xilinx哈夫曼編碼系統(tǒng)設(shè)計　

在圖像處理、文件傳真、視頻壓縮編碼中，哈夫曼編碼是最常用的一種編碼方式。本文設(shè)計并實現(xiàn)了對一段數(shù)字序列進(jìn)行哈夫曼編碼并將編碼結(jié)果串行輸出的電路模塊，電路由輸入數(shù)據(jù)的排序、數(shù)據(jù)的哈夫曼編碼、數(shù)據(jù)序列編碼的結(jié)果輸出三個核心模...

哈夫曼編碼流水線 2017-10-27

基于FPGA的串并集合排序在雷達(dá)系統(tǒng)中的應(yīng)用

在雷達(dá)抗干擾處理以及空時二維處理過程中數(shù)據(jù)排序?qū)⒈夭豢擅?，在傳統(tǒng)的DSP、CPU等常規(guī)軟件排序已經(jīng)不能夠滿足雷達(dá)系統(tǒng)實時性要求，使用 FPGA排序的趨勢將勢不可當(dāng)。FPGA由于具有較高的并行處理能力，目前已成為雷達(dá)陣列信...

排序 FPGA 2016-10-15

FPGA研發(fā)之道(9)架構(gòu)設(shè)計漫談(四)并行與復(fù)用

　　FPGA其在眾多器件中能夠被工程師青睞的一個很重要的原因就是其強(qiáng)悍的處理能力。那如何能夠做到高速的數(shù)據(jù)處理，數(shù)據(jù)的并行處理則是其中一個很重要的方式。　　數(shù)據(jù)的并行處理，從結(jié)構(gòu)上非常簡單，但是設(shè)計上卻是相當(dāng)復(fù)雜，對...

FPGA 架構(gòu)設(shè)計 2014-10-27

用FIFO實現(xiàn)DSP間的雙向并行異步數(shù)字通信

用FIFO實現(xiàn)DSP間的雙向并行異步數(shù)字通信,在多CPU的分布式信號處理系統(tǒng)中,往往涉及CPU間的通訊與數(shù)據(jù)交換,大數(shù)據(jù)量的數(shù)據(jù)傳輸一般采用DMA方式,而小數(shù)據(jù)量的數(shù)據(jù)交換采用并行接口則比較快速靈活。因此,對于傳輸速度要...

異步數(shù)字 2013-02-01

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